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[IT뉴스]래티스, 양자 내성 암호 탑재 보안 제어 FPGA 마크-N2 발표

온카뱅크관리자

2026-09-17 11:07:25

<div id="layerTranslateNotice" style="display:none;"></div> "내부 플래시 품고 30ms 부팅"…CNSA 2.0 보안 규격 완벽 충족 
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 [디지털데일리 김문기 기자] 래티스반도체는 넥서스 2(Lattice Nexus 2) 소형 FPGA 플랫폼을 기반으로 보안 제어 필드프로그래머블게이트어레이(FPGA) '래티스 마크-N2(Lattice Mach-N2)'를 출시했다고 17일 밝혔다.
 에삼 엘라시마위(Esam Elashmawi) 래티스반도체 최고 전략 및 마케팅 책임자(CSMO)는 "양자 컴퓨터 시대의 보안 규정(post-quantum mandates)이 확고히 자리를 잡고, 수명 주기가 긴 인프라를 구축하는 고객들이 현재와 미래의 보안 요구사항에 모두 대응할 수 있는 설계를 위한 솔루션을 추구함에 따라, 시스템 제어 및 보안에 대한 수요가 점점 더 높아지고 있다"며, "Mach-N2는 로직 밀도와 대역폭 측면에서 의미 있는 진전을 달성했을 뿐만 아니라 수명 주기가 긴 시스템을 위해 동급 제품 중에서 가장 완벽한 양자 암호 보안 기능 세트를 제공한다"고 밝혔다.
 앞서 지난 15일 이기훈 래티스코리아 이사는 "사이버 보안 및 어떤 시스템들의 복잡성들이 하드웨어의 개선을 견인하고 있다"라며 "전체적으로 지금 사이버 공격이 점점 데이터 센터 요즘 많이 만들어지고 있는 데이터 센터 그리고 네트워크 인프라 그다음에 엣지 디바이스를 겨냥해서 많은 공격들이 이루어지고 있다"라고 설명했다.
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 이어 "NIST가 이제 PQC의 표준을 완성하고 CNSA 2.0을 현재 발효 중이다"라며 "2030년부터 2033년까지는 최소한 어떤 이런 PQC에 대한 이제 솔루션들을 전부 다 준비를 완료해야 되며 데이터 센터와 네트워크 시스템의 복잡성이 증가함에 따라서 더 빠르고 정교한 보안 제어의 관리가 요구됨에 따라서 이 제품들을 출시하게 되었다"라고 말했다.
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 ◆ 온칩 비휘발성 플래시 탑재…30ms 고속 부팅과 물리적 위변조 차단
 이 이사는 내부 메모리 아키텍처와 관련해 "마크 엑소라는 제품의 특징은 기존의 FPGA들과 다르게 내부에 플래시가 있다는 것이 장점이다"라며 "원래는 FPGA에서 사용하려고 하면 외부의 플래시에서 다운로드 이미지를 플래시에 다운로드 한 다음에 데이터를 읽어온 다음 디바이스가 동작하지만 저희 제품은 플래시를 디바이스 내부 안에 둠으로써 전체 부팅 속도의 향상과 보안성의 혁신을 선도하고 있다"라고 강조했다.
 그는 "내부 설정 메모리가 래티스에만 있으며 요즘 플래시 메모리 가격도 많이 올라가고 외부에 공간을 차지하기 때문에 외부에 플래시가 없고 내부에 플래시가 있다는 것은 고객들이 사용할 때 굉장히 중요한 요소 중에 하나다"라며 "특히 외부로 노출된 플래시 메모리가 아니기 때문에 외부 플래시가 장착된 MCU의 SPI 라인 모니터링 취약점을 방어하는 데 있어서 래티스 FPGA는 외부에 플래시 메모리가 없기 때문에 많은 장점을 가지고 있다"라고 밝혔다.
 마크-N2는 인스턴트 온(Instant-on) 구조를 통해 22만(220k) 시스템 로직 셀 디바이스를 30밀리초(ms) 이내에 설정한다. 이 이사는 "저희는 220k 로직 셀을 부팅하는 데 있어서 30ms 이내에 부팅을 하는데 타사 디바이스들은 대부분 200ms 중반대의 속도가 필요해 약 10배 정도의 빠른 부팅을 지원한다"라고 전했다.
 복구 안정성에 대해 이 이사는 "기존 XO3D는 플래시 2개만 지원했으나 마크-N2는 내부에 유저가 원하는 이미지를 최대 3개까지 저장할 수 있는 유일한 FPGA다"라며 "다운로드 실패나 플래시 주 이미지가 깨지더라도 바로 골든 이미지로 부팅할 수 있어 다양한 복구 시퀀스를 제공한다"라고 설명했다.
 안티 탬퍼(Anti-tamper) 모듈은 시스템 전압 및 내부 온도 임계점을 상시 감시한다. 위험 감지 시 사용자 설정 정책에 맞춰 암호화 키 영구 삭제와 설정 RAM(CRAM) 소거를 실행해 소자를 영구 비활성화한다. 소자 고유 식별 기능에는 물리적 복제 방지 기능(PUF)을 적용했다.
 ◆ CNSA 2.0 풀세트 준수와 고속 인터페이스 확장
 이 이사는 "마크-N2는 암호화 유연성을 갖춘 CNSA 2.0 완전 준수를 위해 양자 내성 암호(PQC) 기술을 디바이스에 결합했다"라며 "타사 디바이스는 PQC 서비스를 제공하지 않거나 일부 서명만 지원하지만 마크-N2는 ML-DSA, LMS, XMSS 등 세 가지 타입의 서명과 ML-KEM 키 교환을 모두 지원하며 CNSA 2.0을 완벽하게 지원하고 있다"라고 밝혔다.
 기존 암호화 표준으로는 AES-256-GCM, ECC-521, 런타임 접근용 RSA-4096 API를 지원하며 해시 및 무결성 검증을 위해 SHA-3, HMAC, 진성 난수 생성기(TRNG)를 내장했다. 플랫폼 증명 프로토콜인 DICE, SPDM 1.4와 시스템 관리 규격 MCTP, PLDM을 통합했다. 현장 업데이트 알고리즘을 통해 롤백 방지(ARP) 기능을 지원한다.
 하드웨어 연결성에 대해 이 이사는 "휴머노이드 플랫폼에서는 다양한 센서를 하나로 모아 10기가비트 이더넷(10GbE)으로 전송하며 마크-N2는 이 부분을 지원해 휴머노이드에도 많이 채택되고 있다"라며 "PCI 익스프레스 4.0(PCIe 4.0)과 16Gbps SERDES를 지원하고 반도체 업계에서 제거 추세인 3.3V I/O를 계속 지원해 다양한 전압 레벨을 유연하게 처리한다"라고 말했다.
 마크-N2는 6만5000(65k)부터 22만(220k) 시스템 로직 셀 규모로 공급된다. 패브릭 동작 속도는 350메가헤르츠(MHz)에 달한다. 메모리는 초당 2133메가비트(Mbps) 전송 속도의 LPDDR4와 표준 DDR4를 결합할 수 있다. 현재 주요 고객사에 샘플을 공급 중이며 설계 소프트웨어 '래티스 래디언트(Lattice Radiant)' 및 신규 AI 도구 '래티스 프롬프트(Lattice Prompt)'를 통해 설계를 지원한다.
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